Eugen G. Leuze Verlag KG
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Veröffentlichungs-NummerDE102015102505A1
Anmeldedatum23/02/2015 00:00:00
Veröffentlichungs-Datum27/08/2015 00:00:00
IPC-HauptklasseH05K 1/11
ErfinderSawada, Takeshi, Yamanashi, Oshino-mura, JP Sugimoto, Nobuhisa, Yamanashi, Oshino-mura, JP
Anmelder/InhaberFANUC CORPORATION, Yamanashi, Oshino-mura, JP
  
Offenlegungsschrifthttps://depatisnet.dpma.de:443/DepatisNet/depatisnet?window=1&space=main&content=treffer&action=pdf&docid=DE102015102505A1
  
Vollständige Beschreibunghttps://depatisnet.dpma.de:443/DepatisNet/depatisnet?window=1&space=main&content=treffer&action=textpdf&docid=DE102015102505A1
  
AbstractIn einer Leiterplatte, auf welcher eine elektronische Komponente montiert ist, die Elektrodenanschlussreihen auf vier umfänglichen Seiten oder zwei gegenüberliegenden Seiten davon umfasst, erstreckt sich jede von Lötflächen an den beiden Enden von Lötflächenreihen, die den Elektrodenanschlussreihen entsprechen, in Bezug auf die anderen Lötflächen in der Anordnungsrichtung der Lötflächen nach außen und weist eine Form auf, die durch diagonales Abschneiden einer Ecke erhalten wird, die am weitesten entfernt von der Mitte der elektronischen Komponente angeordnet ist.

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