Eugen G. Leuze Verlag KG
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Veröffentlichungs-NummerDE102015100846A1
Anmeldedatum21/01/2015 00:00:00
Veröffentlichungs-Datum30/07/2015 00:00:00
IPC-HauptklasseH05K 3/42
ErfinderIto, Kenichi, c/o Fanuc Corporation, Yamanashi, Oshino-mura, JP Sakamoto, Kazuki, c/o Fanuc Corporation, Yamanashi, Oshino-mura, JP
Anmelder/InhaberFANUC CORPORATION, Yamanashi, Oshino-mura, JP
  
Offenlegungsschrifthttps://depatisnet.dpma.de:443/DepatisNet/depatisnet?window=1&space=main&content=treffer&action=pdf&docid=DE102015100846A1
  
Vollständige Beschreibunghttps://depatisnet.dpma.de:443/DepatisNet/depatisnet?window=1&space=main&content=treffer&action=textpdf&docid=DE102015100846A1
  
AbstractDie vorliegende Erfindung stellt eine Leiterplatte mit einem Leitungsmuster und einem Kontaktloch auf einer oder beiden Oberflächen der Leiterplatte, einem Lötresist und einer Lötmittelbeschichtung auf einer Oberfläche des Leitungsmusters und des Kontaktlochs und einer Grenzfläche zwischen dem Lötresist und der Lötmittelbeschichtung bereit, und die Leiterplatte weist ferner eine Lötresistschicht auf, welche die Grenzfläche von einer oder beiden Oberflächen der Leitplatte abdeckt.

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